请选择 进入手机版 | 继续访问电脑版

明德扬论坛

 找回密码
 立即注册

QQ登录

只需一步,快速开始

微信扫一扫,快捷登录!

查看: 601166|回复: 7

VIVADO软件交流【汇总贴】

[复制链接]

35

主题

57

帖子

7612

积分

管理员

Rank: 9Rank: 9Rank: 9

积分
7612

荣誉管理论坛元老

QQ
发表于 2020-5-15 18:03:56 | 显示全部楼层 |阅读模式

马上注册,看完整文章,学更多FPGA知识。

您需要 登录 才可以下载或查看,没有帐号?立即注册

x
温馨提示:明德扬2023推出了全新课程——逻辑设计基本功修炼课,降低学习FPGA门槛的同时,增加了学习的趣味性,并组织了考试赢积分活动
(点击→了解课程详情)http://www.mdy-edu.com/ffkc/415.html感兴趣请联系易老师:13112063618(微信同步)


VIVADO使用教程


【关键问题!!!!重要!!!】VIVADO会在MESSAGE窗口出提示很多错误和警告信息!
A04C9A55-1A6B-4015-AED2-6F8C02AFB331.png
但建议大家不要看此信息,原因如下:
1. 这些信息有可能是过时的,可能是之前报错了,因此修正了,这些信息没有更新。
2. 有些信息是错误的,但不影响整个工程的运行,例如某个IP核出错,但实际工程没使用此IP核。
3. 这些信息没有顺序,即哪些错误是先发生的不知道,影响定位。
总之不要看MESSAGE栏的内容。
最权威的信息,应该看LOG。如下图
D5E969F3-9C6D-416e-AEAD-58A7D5E0E2D0.png
要看LOG这一栏。 这一栏中,有Synthesis和Implementation这两部分内容。建议整个工程运行后,再看LOG中,第一个报错的地方,解决第一个报错的问题。


【问题1】使用VIVADO编译时出现如下错误,我使用的是K7芯片。
TIM图片20200515180040.png
答:仔细阅读提示,该提示是说本软件没有K7芯片的license。您需要去官方下载一个K7芯片的LICENSE使用,该LICENSE是免费的。
LICENSE的申请方法,请参考:https://blog.csdn.net/wxh0000mm/article/details/84068162
注意,上面链接中讲的是申请VIVADO LICENSE的方法,本问题是指K7芯片的LICENSE,要选择时注意选正确。


【问题2】ILA报如下错误,大概意思是有一些信号没有连接。

The debug port 'u_ila_0/probe4' has 1 unconnected channels (bits). This will cause errors during implementation
答:1. 该报错是指ILA里有一些接口没有连接。您要检查一下例化时,是否全部的probe都已经连接了,
       尤其需要注意的是:里面的每个probe位宽都要正确,也就是probe的位宽和信号位宽要一样。
      2. 在message界面显示的是之前残留的信息,需要点一次reset synthesis run,重新RUN一遍,查看最新的提示信息。


【问题3】VIVAOD添加include文件报错。

TIM图片20200712104917.jpg
答:一般include进来的文件,不是一个完整的module代码。该代码是不能像其他代码那样,通过添加文件的方式加到本工程,这是不正确的。     
     正确的方式是,在VIVADO的设置界面(在最左边的窗口,PROJECT MANAGER,点击setting),然后按下图设置。
TIM图片20200712110818.png
如果还报错,注意要把该文件从工程中remove掉。

【问题4】不添加ILA,可以顺利生成bit流文件。添加ILA后,就在布局布线这里报错,这是什么原因呢?
答:使用ILA的时候,特别注意ILA的信号个数、信号位宽要与被测信号一致,否则会存在编译不通过的风险
lALPBGKoadQEQzjNASLNBog_1672_290.png
像这种错误提示,如果看不懂,则看关键词和提示的信号。如上图中的FSM_onehot_state_c[0]信号,从代码上检查该信号是否存在以下问题。

1. 该信号是不是没有被驱动(也就是没被赋值);
2. 该信号是不是被 优化(包括直接或者间接未被使用);
3. 信号位宽不正确;
4. 该信号与其他信号有哪些不同。
5. 再不行,尝试改改该信号信号,重新综合看


【问题5】以下图片出现?号问题是怎么回事?

答:出现问号,是表示该文件没有添加到文件,请把该代码添加到工程


【问题6】 出现以下警告 Synthesis(101 critical warnings),请问如何解决?

答:拉信号到调试工具引起的警告,MDY不使用此方法,所以没遇到过。建议使用例化ILA的方法,我们已经形成了一套规范方法,有兴趣可以看下面链接 :
VIVADO使用教程http://www.fpgabbs.cn/forum.php? ... d=1023&fromuid=9396   请看 第六集:VIVADO教程06-MDY的ILA使用经验


【问题7】 出现器件识别不到有如下可能原因,如下图所示,请问是什么原因 ?



答:
1.下载器有问题,可以换一个下载器看看。
2.硬件电路有问题,需要检查。
3.电源未开。
4.下载器插反了。
5.FPGA芯片有问题,以上是可能原因。


【问题8】老师,什么情况下不用sdk?
答:只有纯逻辑设计,没有用到软核和ARM的时候,可以不用sdk。


【问题9】
下面是AXI总线的时序图,但我仿真发现,在AWVALID之前,AWREADY就变高了,这是错误的吗?


答:上面时序没有说,在AWVALID之后,AWREADY才为1。上图只是要说明的是:AWVALID和AWREADY同时为1,才表示一个有效的数据。
       AWREADY是可以任意时候为1的.这也告诉我们,时序不要想当然地理解。


【问题10】Vivado-Synthesis: Verilog parameter overridden within instantiation fails with "ERROR:[Synth 8-3438]"
1.jpg
答:这句提示是说:在例化的时候,参数TBYTE_SCR在设计文件里找不到。即原设计文件里没有TBYTE_SCR,但例化的时候又使用了。


【问题11】布线里route design跑很久,不知是什么回事?
答:1.使用增量编译的方法,会节省一些时间。具体做法可以百度;
      2.换一台性能更好的电脑。



【问题12】在布局布线时,提示DRC错误,错误如下图。

2CC1653E-B6D2-401c-A2EB-A8C3FD4ED3E4.png
答:看提示,一般抓关键词。注意图中的关键词:bank 14,rst_n,LVCMOS25,si5388_scl,LVCMOS33。在开发过程,要和这些词关联起来的步骤就是配置管脚,并且这些管脚与BANK14有关。
     所以根据提示,可以去检查配置管脚的页面。
     其实这里的问题是:在同一个BANK的管脚,其电压标准必须是相同的,例如都使用2.5V标准,或者都用3.3V标准。LVCMOS25是2.5V的,LVCMOS33是3.3V的。
     解决方法:将rst_n配置成LVCMOS33,或者将si5388_scl配置成LVCMOS25



【问题13】老师使用ILA采样的时候 说明波形也没有 并且有这个警告是怎么回事啊-----Vivado INFO [Labtools 27-1964]
3.jpg
答:1、检查是否添加了siganls,并且您能够更早地看到它们,现在它们消失了?
      2、
可以关闭hw_ila1窗口,然后重新打开并检查是否可以看到任何信号吗?
      如果不是,请单击“ +”按钮并手动添加信号。同时点击立即触发并重新检查


【问题14】老师这个管脚驱动强度是什么意思啊  选择的时候应该怎么选?

2.jpg
答:可以使用默认值,一直没改过


【问题15】我的iP显示锁定,更新IP怎么是locked by user

111.jpg
答:这是设计师对自己写的代码锁定了,其他人无法修改。所以这个就是直接使用即可。如果使用有问题,请找原设计师。


【问题16】使用VIVADO的DEBUG工具时,提示“clock has stopped,unable to arm ILA”
1BDD053F-F0DA-4ba5-95AA-A9D6C7924B7E.png 1663FD8C-3C02-44df-9026-F4C3F69AE319.png
答:该提示是说,时钟信号停止了,也就是说上述做对中gtx_rx_clk没有像时钟那样,高低高低变化。请检查该信号,是不是拼写错误,还是说该时钟确实没有。


【问题17】Unrouted nets:4 net(s) are unrouted .The problem bus(es) and/or net(s) are............

答:出现这个错误的原因一般是:xdc文件中的约束不正确或者冲突,解决方法如下
1、根据实际使用情况重新进行约束
2、在将IOB属性更改为TRUE


【问题18】:在vivado软件中烧写比特流时,打开硬件目标找不到JTAG,open target连接不上,显示信息为:
  INFO: [Labtools 27-2285] Connecting to hw_server url TCP:localhost:3121

答:1.确认已经链接了下载器? 111.jpg

2.确认开发板已经通电状态?

3.有可能是下载器坏了,可以更换下载器看看?

4.有可能是板子硬件有问题 可以换板子试试看

5.有可能是Vivado的驱动没有安装好,只需要将驱动安装上即可,建议在安装的过程中,将vivado关闭以及Jtag连接器先拔掉,安装驱动成功后在重新开始打开vivado进行连接;
否则可能会在安装后也不能正常连接。在点击open target时,请将设备电源打开。


【问题19】
1.jpg
答:这是因为我们在添加文件时候,忘记添加NGC文件到工程目录中。下面就演示如何添加NGC文件到工程目录中。NGC文件既要添加到Synthesize的目录下,也要添加到Implement目录下。

第一步:在Synthesize下添加NGC文件

如图在SynSynthesize中选择Process Properities

1.png


在Synthesis Options中可以看到-sd和-vlgincdir。在-sd一栏中添加工程中所有的ngc或的edn文件的路径目录。在-vlgincdir中添加define.v文件的目录。

2.png


第二步:在到Implement目录下添加NGC文件

如图在Implement Design中选择Process Properities。

3.png


在Translate Properties中的-sd一栏中添加添加工程中所有的ngc或的edn文件的路径目录否则translate的时候会出错。

4.png



【问题20】打开MDY的工程后,会提示如下错误信息

微信图片_20210106162051.png

答:1. 工程中的路径,不要有中文的。

      2. 上面提示是IP核找不到。但这些IP核有可能是没有用到的,所以这个错误可以不用理会。



【问题21】打开MDY的工程,IP核如下显示,无法打开。

微信图片_20210106162233.png

答:MDY的工程,在分享的时候会减少大小,会删除很多无用的文件。用户下载后,需要重新生成IP核或升级IP核。

     方法是在IP核右键,reset IP,然后重新“generate” IP。另外,不同的VIVADO版本,也会造成此情况,要特别留意。VIVADO版本要保持一致。





0

主题

5

帖子

81

积分

注册会员

Rank: 2

积分
81
发表于 2020-7-12 11:32:40 | 显示全部楼层
针对【问题3】VIVAOD添加include文件报错。可以将ov7670_para.v文件设置为Verilog Header类型 QQ图片20200712113109.png
【问题4】ila核和vio核只能看带有时钟的信号是么?可不可以看组合逻辑答:ILA核是可以看组合逻辑信号的

0

主题

5

帖子

81

积分

注册会员

Rank: 2

积分
81
发表于 2020-7-12 11:40:57 | 显示全部楼层
谢谢博主,根据问题三中的答案设置,已经解决问题,

0

主题

1

帖子

77

积分

注册会员

Rank: 2

积分
77
发表于 2020-11-13 09:38:59 | 显示全部楼层
老师这篇真的是及时雨,解了很多疑惑,但是目前我遇到一个棘手的问题,还请老师解答,在线等:
比如我有个差分时钟输入信号定义在FPGA板子上的差分pin位置,但是跑完综合调出IO Port,手动选总是选不上那个定义的位置
xdc中定义的是AN45(CSI_CLKP),AN46(CSI_CLKN),但是综合后无法fix,我手动输入AN,都没有显示AN45这个位置
但是其他信号就可以选中这个位置,
百度了一下差分信号只能约束P端口,我修改xdc文件只约束p段还是不行,
设计中我是用IBUFDS原语,只要加上这句话,就不能fix,去掉没有任何设计在内,则可以

0

主题

3

帖子

40

积分

禁止发言

积分
40
发表于 2023-7-18 17:01:22 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
回复

使用道具 举报

您需要登录后才可以回帖 登录 | 立即注册

本版积分规则

QQ|手机版|小黑屋|MDYBBS ( 粤ICP备16061416号 )

GMT+8, 2024-12-12 18:54 , Processed in 0.061852 second(s), 24 queries .

Powered by Discuz! X3.4

本论坛由广州健飞通信有限公司所有

© 2001-2019 Comsenz Inc.

快速回复 返回顶部 返回列表